计算机基础知识

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A simple 5-stage Pipeline RISC-V core

This is my graduation project, a simple processor soft core, which implements RV32I ISA.

一个使用risc-指令集的cpu，五级流水线

The CORE-V CVA6 is an Application class 6-stage RISC-V CPU capable of booting Linux

UESTC Thesis Latex Template 2023. It fully supports the latest format specification in 2023, supports independent symbol table, abbreviation table, and complete and fully customizable Academic/Prof…

a training-target implementation of rv32im, designed to be simple and easy to understand

RISC-V CPU with 5-stage pipeline, implemented in Verilog HDL.

RISC-V CPU, simple 5-stage in-order pipeline, for low-end applications needing MMUs and some performance

电子科技大学计算机科学与工程学院（网络空间安全学院）网络空间安全专业本科生课程实验及学习资料

电子科技大学(UESTC)计算机科学与技术专业本科生课程实验

《C++ Primer Plus 第6版（中文版）》原书代码、习题答案和个人笔记，仅供学习和交流。

在电子科大本科期间所有课程课设和作业的代码和部分报告，包括【计算机组成与结构】、【计算机网络与通信技术】、【软件基础综合课程设计】、【互联网软件开发综合课程设计】、【数据挖掘与大数据分析】、【时间序列分析】、【机器学习】、【数据结构与算法】、【并行程序设计导论】、【计算机操作系统】、【计算机视觉】

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我将在这里分享我在学习中遇到的学习资源，优质、系统、只为分享。

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计算机自学指南

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